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Einleitung

Dieser Text beschreibt den Entwurf von ASICs mit Standardzellen in $0.7 \mu m$ CMOS-Technologie. Es werden die wesentlichen Abläufe angegeben, mit Tips, wie man einige Programmfehler umgehen kann. Leider ist diese Version des Design Kits sehr fehlerhaft, was hoffentlich bei nachfolgenden Versionen nicht mehr der Fall sein wird.

Der Ablauf wird an einem Beispiel erklärt, einem 256-Byte-FIFO-Speicher.


 

Thilo Thiessenhusen
16. 4. 1999